文章 2024-07-18 来自:开发者社区

基于FPGA的MSK调制解调系统verilog开发,包含testbench,同步模块,高斯信道模拟模块,误码率统计模块

1.算法仿真效果本程序系统是《m基于FPGA的MSK调制解调系统verilog开发,并带FPGA误码检测模块和matlab仿真程序》的的升级。 升级前原文链接 增加了完整的AWGN信道模型的FPGA实现,可以在testbench里面设置SNR,分析不同SNR对应的FPGA误码率情况。 vivado2019.2仿真结果如下(完整代码运行后无水印): 设置SNR=0: 设置SNR=5:...

基于FPGA的MSK调制解调系统verilog开发,包含testbench,同步模块,高斯信道模拟模块,误码率统计模块
文章 2023-11-04 来自:开发者社区

基于FPGA的Lorenz混沌系统verilog开发,含testbench和matlab辅助测试程序

1.算法运行效果图预览 将vivado的仿真结果导入到matlab显示三维混沌效果: 2.算法运行软件版本vivado2019.2 matlab2022a 3.算法理论概述 洛伦兹混沌系统是一种非线性动力系统,最初由爱德华·洛伦兹(Edward Lorenz)于1963年引入,它的简单方程组引发了混沌理论的开创性研究。该系统是混沌现象的典型范例,展示了复杂、不可预测的行为,即使在...

基于FPGA的Lorenz混沌系统verilog开发,含testbench和matlab辅助测试程序
文章 2023-06-23 来自:开发者社区

基于FPGA的DDS开发和实现,可修改输出正弦的频率和相位,包含testbench

1.算法仿真效果vivado2019.2仿真结果如下: 输出2个不同频率的正弦信号: 修改相位,得到如下所示。 2.算法涉及理论知识概要 直接数字频率合成技术 (Direct Digital Synthesis)完全不同于我们己经熟悉的直接频率合成技术和锁相环频率合成技术。直接数字频率合成技术(简称DDS)的理论早在七十年代就被提出。它的基本原理就是利用采样定理,通过查表法产生波...

基于FPGA的DDS开发和实现,可修改输出正弦的频率和相位,包含testbench
文章 2023-05-19 来自:开发者社区

基于FPGA的Hamming编译码verilog开发实现,包括testbench测试程序

1.算法仿真效果vivado2019.2仿真结果如下: 2.算法涉及理论知识概要 汉明码(Hamming Code),是在电信领域的一种线性调试码,以发明者理查德·卫斯里·汉明的名字命名。汉明码在传输的消息流中插入验证码,当计算机存储或移动数据时,可能会产生数据位错误,以侦测并更正单一比特错误。由于汉明编码简单,它们被广泛应用于内存(RAM)。 人们在汉明码出现之前使用过多种检查错...

基于FPGA的Hamming编译码verilog开发实现,包括testbench测试程序
文章 2023-05-17 来自:开发者社区

基于FPGA的FIR低通滤波器verilog开发,包含testbench测试程序,输入噪声信号使用MATLAB模拟产生

1.算法仿真效果VIVADO2019.2/matlab2022a仿真结果如下: 运行matlab: 将matlab得到的数据文件保存到FPGA的project_13.sim\sim_1\behav\xsim路径,测试仿真时,可以自动调用matlab任意产生的测试数据。 rtl: 2.算法涉及理论知识概要 FIR(Finite Impulse Response)滤波器:...

基于FPGA的FIR低通滤波器verilog开发,包含testbench测试程序,输入噪声信号使用MATLAB模拟产生
文章 2023-04-08 来自:开发者社区

基于FPGA的AES加密解密vivado仿真,verilog开发,包含testbench

1.算法描述 AES, 高级加密标准, 是采用区块加密的一种标准, 又称Rijndael加密法. 严格上来讲, AES和Rijndael又不是完全一样, AES的区块长度固定为128比特, 秘钥长度可以是128, 192或者256. Rijndael加密法可以支持更大范围的区块和密钥长度, Rijndael使用的密钥和区块长度均可以是128,192或256比特. AES是对称加密最流行的...

基于FPGA的AES加密解密vivado仿真,verilog开发,包含testbench

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