黑金FPGA云服务器驱动模块的相关内容

文章 2022-02-16 来自：开发者社区

【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十三：串口模块② — 接收

实验十三：串口模块② — 接收我们在实验十二实现了串口发送，然而这章实验则要实现串口接收 ... 在此，笔者也会使用其它思路实现串口接收。图13.1 模块之间的数据传输。假设我们不考虑波特率，而且一帧数据之间的传输也只是发生在FPGA之间，即两只模块之间互转，并且两块模块都使用相同的时钟频率，结果如图13.1所示。只要成立上述的假设成立，串口传输不过是简单的数据传输活动而已，图中...

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十二：串口模块① — 发送

实验十二：串口模块① — 发送串口固然是典型的实验，想必许多同学已经作烂，不过笔者还要循例介绍一下。我们知道串口有发送与接收之分，实验十二的实验目的就是实现串口发送，然而不同的是 ... 笔者会用另一种思路去实现串口发送。图12.1 PS/2发送时序与串口发送时序。如图12.1所示，串口发送时序相较PS/2发送时序，串口发送时序就像断了翅膀的小鸟般，没有时钟信号控制整个传输协议。除此之外.....

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十一：PS/2模块⑤ — 扩展鼠标

实验十一：PS/2模块⑤ — 扩展鼠标当普通鼠标即三键鼠标再也无法满足需求的时候，扩展鼠标即滚轮鼠标就诞生了，然而实验十一的实验目的就是实现滚轮鼠标的驱动。不过，进入整体之前，先让我们来了解一下鼠标的常用命令。图11.1 命令F3，设置采样频率。命令F3也是Set Sample Rate，主要是用来设置采集频率。笔者曾经说过，采集频率就是鼠标采集按键状况还有位置状况的间隔时间，默认下是1.....

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十七：IIC储存模块 - FIFO读写

1. int main() 2. { 3. int A； 4. A = 16； 5. } 代码17.1 话题为进入之前，首先让我们来聊聊一些题外话。那些学过软核NIOS的朋友可曾记得，软核NIOS可利用片上内存作为储存资源，而且它也能利用SDRAM作为储存资源，然而问题是在这里 ... 如代码17.1所示，笔者先建立变量A，然后变量A赋值16。如果站在高级语言上的角度去思考，无论是建立...

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十六：IIC储存模块

IIC储存器是笔者用来练习精密控时的经典例子。《整合篇》之际，IIC储存器的解释，笔者也自认变态。如今笔者回头望去，笔者也不知道自己当初到底发什么神经，既然将IIC的时序都解释一番。由于开发上板也嵌着IIC储存器（24LC04），笔者还得循例地介绍一下。 IIC储存器是应用IIC总线的储存器，时序本身并不是很复杂不过缺有一大堆时序参数，而且官方提供的时序也不利于描述，所以许多时序都必...

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十五：FIFO储存模块（同步）

实验十五：FIFO储存模块（同步）笔者虽然在实验十四曾解释储存模块，而且也演示奇怪的家伙，但是实验十四只是一场游戏而已。至于实验十五，笔者会稍微严肃一点，手动建立有规格的储存模块，即同步FIFO。那些看过《时序篇》的同学一定对同步FIFO不会觉得陌生吧？因为笔者曾在《时序篇》建立基于移位寄存器的同步FIFO。不过那种同步FIFO只是用来学习的玩具而已。因此，这回笔者可要认真了！事实告诉笔者，....

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十九：SDRAM模块② — 多字读写

实验十九：SDRAM模块② — 多字读写表示19.1 Mode Register的内容。 Mode Register A12 A11 A10 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0 0 0 OP Code 0 0 CAS Latency BT Burst Length ...

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十八：SDRAM模块① — 单字读写

实验十八：SDRAM模块① — 单字读写笔者与SDRAM有段不短的孽缘，它作为冤魂日夜不断纠缠笔者。笔者尝试过许多方法将其退散，不过屡试屡败的笔者，最终心情像橘子一样橙。《整合篇》之际，笔者曾经大战几回儿，不过内容都是点到即止。最近它破蛊而出，日夜不停：“好~痛苦！好~痛苦！”地呻吟着，吓得笔者不敢半夜如厕。疯狂之下，誓要歪它不可 ... 可恶的东西，笔者要它血债血还！图18.1 数据读取.....

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验二十三：DS1302模块

实验二十三：DS1302模块 DS1302这只硬件虽然曾在《建模篇》介绍过，所以重复的内容请怒笔者懒惰唠叨了，笔者尽可以一笑带过，废话少说让我们进入正题吧。DS1302是执行事实时钟（Real Time Clock）的硬件，采用SPI传输。表示23.1 访问（地址）字节。 [7] [6] [5] [4] [3] [2] [1] [0] 1 A5 ...

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【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验二十一：SDRAM模块④ — 页读写 β

实验二十一：SDRAM模块④ — 页读写 β 未进入主题之前，让我们先来谈谈一些重要的体外话。《整合篇》之际，笔者曾经比拟Verilog如何模仿for循环，我们知道for循环是顺序语言的产物，如果Verilog要实现属于自己的for循环，那么它要考虑的东西除了步骤以外，还有非常关键的时钟。 for( i=0; i<4; i++ ) 操作A； i = 0； while ( i&l...