FPGA驱动VGA显示
一. VGA时序图下面引用黑金教程里面的一个图片。所以VGA显示的时序图都是如此的。从图中可以看到两个信号线,分别是行同步和列同步,它们都是在同步时间内拉高,其余时间都为低电平。从图中可以得知,在每一行的开始,行同步拉高,在每一列的开始,列同步拉高,它们各自拉高的时间可以参考手册。二. 查看手册这里以AN430显示模块的手册为例。通过手册可以清楚的看出,显示的时钟频率以及各个状态所对应的持续时间....

【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验二十六:VGA模块
实验二十六:VGA模块 VGA这家伙也算孽缘之一,从《建模篇》那时候开始便一路缠着笔者。《建模篇》之际,学习主要针对像素,帧,颜色等VGA的简单概念。《时序篇》之际,笔者便开始摸索VGA的时序。《整合篇》之际,笔者尝试控制VGA的时序。如今《驱动篇I》的内容返回VGA的本题,也就是图像方面的故事。 此刻,澎湃之情不容怠慢,请怒笔者不再回忆往事,失忆者请复习《Verilog HDL那些事儿》,...
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