FPGA入门（6）：数码管静态/动态显示（二）
FPGA入门（6）：数码管静态/动态显示（一)+https://developer.aliyun.com/article/1556559 data_gen.v `timescale 1ns/1ns module data_gen #( parameter CNT...
FPGA入门（7）：IP核调用（二）
FPGA入门（7）：IP核调用（一）+https://developer.aliyun.com/article/1556568 rom_ctrl.v `timescale 1ns/1ns module rom_ctrl #( parameter CNT_MAX = ...
FPGA入门（7）：IP核调用（一）
第24讲：快速开发的法宝：IP核 IP核是什么？ IP（Intellectual Property）即知识产权。在半导体产业将IP核定义为“用于ASIC或FPGA中的预先设计好的电路功能模块”。简而言之，这里的IP即电路功能模块。 在数字电路中，将常用的且比较复杂的功能模块设计成参数可修改的模块，让其他用户可以直接调用这些模块，这就是IP核。 ...
FPGA入门（4）：时序逻辑（二）
FPGA入门（4）：时序逻辑（一）+https://developer.aliyun.com/article/1556542 tb_counter.v `timescale 1ns/1ns module tb_counter(); //wire define wire ...
FPGA入门（2）：Verilog HDL基础语法
Verilog HDL是一种硬件描述语言，以文本形式来描述数字系统硬件的结构和行为的语言，用它可表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。 Verilog语言： 语法自有，易学易用 适合算法级、门级设计 代码简洁 发展较快 VHDL语言： 语法严谨，难以上手 适合系...
FPGA入门（4）：时序逻辑（一）
组合逻辑存在竞争冒险 第11讲：寄存器 寄存器具有存储功能，一般是由D触发器构成，由时钟脉冲控制，每个D触发器能够存储一位二进制码。 D触发器的工作原理：在一个脉冲信号（一般为晶振产生的时钟脉冲）上升沿或下降沿的作用下，将信号从输入端D送到输出端Q，如果时钟脉冲的边沿信号未出现，即使输入信号改变，输出信号仍然保持原值，且寄存器拥有复位清零功能，其复位又分为同步复位和异步复...
FPGA入门（5）：控制LED灯
第17讲：触摸按键控制LED灯 触摸按键可分为四大类：电阻式、电容式、红外感应式、表面声波式 电容式触摸按键主要由按键IC部分和电容部分构成；按键IC用于将电容的变化转换为电信号；电容部分指的是由电容极板、地、隔离区等组成触摸按键的电容环境。 ...
【FPGA基础入门实践】Verilog 基本项目操作逐步演示
0x00 回顾：AND/OR/NOT 逻辑的特性AND：与门可以具有两个或更多的输入，并返回一个输出。当所有输入值都为 1 时，输出值为 1。如果输入值中有任何一个为 0，则输出值为 0。OR：或门可以具有两个或更多的输入，并返回一个输出。如果输入值中至少有一个为 1，则输出值为 1。...
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